quasar/exu_alu_ctl.anno.json

244 lines
8.6 KiB
JSON

[
{
"class":"firrtl.transforms.CombinationalPath",
"sink":"~exu_alu_ctl|exu_alu_ctl>io_predict_p_out_valid",
"sources":[
"~exu_alu_ctl|exu_alu_ctl>io_pp_in_valid"
]
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{
"class":"firrtl.transforms.CombinationalPath",
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"sources":[
"~exu_alu_ctl|exu_alu_ctl>io_flush_upper_x",
"~exu_alu_ctl|exu_alu_ctl>io_dec_tlu_flush_lower_r",
"~exu_alu_ctl|exu_alu_ctl>io_pp_in_bits_pret",
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"~exu_alu_ctl|exu_alu_ctl>io_pp_in_bits_pja",
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]
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"sink":"~exu_alu_ctl|exu_alu_ctl>io_predict_p_out_bits_toffset",
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"~exu_alu_ctl|exu_alu_ctl>io_pp_in_bits_toffset"
]
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"class":"firrtl.transforms.CombinationalPath",
"sink":"~exu_alu_ctl|exu_alu_ctl>io_flush_path_out",
"sources":[
"~exu_alu_ctl|exu_alu_ctl>io_pp_in_bits_pret",
"~exu_alu_ctl|exu_alu_ctl>io_pp_in_bits_pja",
"~exu_alu_ctl|exu_alu_ctl>io_i0_ap_jal",
"~exu_alu_ctl|exu_alu_ctl>io_pp_in_bits_pcall",
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"~exu_alu_ctl|exu_alu_ctl>io_i0_ap_predict_t",
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"class":"firrtl.transforms.CombinationalPath",
"sink":"~exu_alu_ctl|exu_alu_ctl>io_predict_p_out_bits_way",
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"sink":"~exu_alu_ctl|exu_alu_ctl>io_predict_p_out_bits_pcall",
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"~exu_alu_ctl|exu_alu_ctl>io_pp_in_bits_pcall"
]
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"class":"firrtl.transforms.CombinationalPath",
"sink":"~exu_alu_ctl|exu_alu_ctl>io_predict_p_out_bits_hist",
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"~exu_alu_ctl|exu_alu_ctl>io_pp_in_bits_pja",
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"class":"firrtl.transforms.CombinationalPath",
"sink":"~exu_alu_ctl|exu_alu_ctl>io_predict_p_out_bits_br_start_error",
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"~exu_alu_ctl|exu_alu_ctl>io_pp_in_bits_br_start_error"
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"class":"firrtl.transforms.CombinationalPath",
"sink":"~exu_alu_ctl|exu_alu_ctl>io_predict_p_out_bits_br_error",
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"sink":"~exu_alu_ctl|exu_alu_ctl>io_predict_p_out_bits_prett",
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"~exu_alu_ctl|exu_alu_ctl>io_pp_in_bits_prett"
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"class":"firrtl.transforms.CombinationalPath",
"sink":"~exu_alu_ctl|exu_alu_ctl>io_flush_final_out",
"sources":[
"~exu_alu_ctl|exu_alu_ctl>io_dec_tlu_flush_lower_r",
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"~exu_alu_ctl|exu_alu_ctl>io_i0_ap_predict_t",
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"~exu_alu_ctl|exu_alu_ctl>io_i0_ap_bge",
"~exu_alu_ctl|exu_alu_ctl>io_pp_in_bits_pja",
"~exu_alu_ctl|exu_alu_ctl>io_i0_ap_sub",
"~exu_alu_ctl|exu_alu_ctl>io_i0_ap_blt",
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"class":"firrtl.transforms.CombinationalPath",
"sink":"~exu_alu_ctl|exu_alu_ctl>io_predict_p_out_bits_boffset",
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"~exu_alu_ctl|exu_alu_ctl>io_pp_in_bits_boffset"
]
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"sink":"~exu_alu_ctl|exu_alu_ctl>io_flush_upper_out",
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]
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{
"class":"firrtl.EmitCircuitAnnotation",
"emitter":"firrtl.VerilogEmitter"
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"class":"firrtl.transforms.BlackBoxResourceAnno",
"target":"exu_alu_ctl.gated_latch",
"resourceId":"/vsrc/gated_latch.sv"
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"class":"firrtl.options.TargetDirAnnotation",
"directory":"."
},
{
"class":"firrtl.options.OutputAnnotationFileAnnotation",
"file":"exu_alu_ctl"
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"class":"firrtl.transforms.BlackBoxTargetDirAnno",
"targetDir":"."
}
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